不出意外的话，3月初的财务分析师会议会上amd就会宣布rdna2代gpu架构，不仅支持硬件光追，而且规模更大，传闻中big navi大核心性能可超越rtx 2080 ti，有可能命名为rx 5950 xt显卡。
日前还有更详细的规格泄露，有sk海力士员工泄露了d32310/15的部分参数，gpu包括80组cu、5120个流处理器，320个tmu（纹理单元）、96个rop光栅单元，二级缓存12mb。
显存方面，24gb hbm2e，4096bit，带宽高达2tb/s（针脚带宽4gbps）。
这个传闻这两天引发了国内外a饭的热议，不过sk海力士方面已经辟谣了，否认发表过相关爆料，要求停止传播这一谣言。
sk海力士的辟谣没完全消除大家的“误解”，因为上面那个爆料看起来很准确，很多人还是深信不疑，毕竟这个爆料显示出big navi真的是很好很强大。
那就是专业角度来辟谣吧，hardwaretimes网站发文分析了爆料中的big navi显卡的规格出，认为有三处是不可能的：
第一，24gb hbm2e、2048gb/s的显存配置是不可能的。hbm2e显存虽然可以做到12-hi堆栈，但普通是8-hi堆栈，每个hbm2e芯片的等位位宽是1024bit，每个芯片核心容量16gbit，总堆栈16gb，1.2ghz等效频率下带宽410gb/s。
如果是2个芯片堆栈一组，那么速率3.2gbps，总容量32gb，每通道位宽2048bit。
再来看上面的爆料，24gb hbm2e显存意味着等效位宽1536bit，很诡异，而且带宽还达到了2048gb/s，这也是不可能的，每个hbm2e的带宽只有410gb/s，2组也不超过1024gb/s。
第二个疑点是rop光栅单元，爆料称它是96组rop，但rx 5700 xt中是64组rop，big navi说是2倍规模，那rop单元应该是128个才对。
理论上来说，96组rop单元也不是绝对不可能出现，这时候内存控制器就是混合的、不对等的。
还有就是l2缓存容量，爆料显示是12mb l2缓存，这是rx 5700 xt的3倍，但如果cu单元只是翻倍，那应该是8mb l2缓存才合理，除非amd在rdna 2架构中改变了l2缓存配置。
总之，不论从哪一方面来看，这次爆料big navi核心的规格都不太合理，漏洞很多，再加上sk海力士的辟谣，这次的泄漏大概率是假的。
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